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dc.contributor.advisorUribe Aponte, José Luis
dc.contributor.advisorViveros Moreno, Francisco
dc.contributor.authorGaray Rodríguez, Pablo Andrés
dc.date.accessioned2015-11-08T22:12:13Z
dc.date.accessioned2016-03-29T17:49:34Z
dc.date.accessioned2020-04-16T16:33:06Z
dc.date.accessioned2023-05-10T17:13:58Z
dc.date.available2015-11-08T22:12:13Z
dc.date.available2016-03-29T17:49:34Z
dc.date.available2020-04-16T16:33:06Z
dc.date.available2023-05-10T17:13:58Z
dc.date.created2014
dc.identifier.urihttps://hdl.handle.net/20.500.12032/91481
dc.description.abstract"El presente trabajo desarrolla un ""Sistema de Depuración para procesadores de Arquitectura CORTEX"", se desarrolló haciendo uso del Software Quartus II de Altera. El trabajo hace parte de la sección de técnicas Digitales y está basado en un trabajo de grado anterior titulado ""PROCESADOR DIGITAL, ARQUITECTURA ARM CORTEX-M3"" No 1162, se plantea el uso de Breakpoints para realizar detenciones sobre dicho procesador y se realiza el control de flujo de la ejecución del programa mediante saltos por ciclo de instrucción o saltos entre instrucciones seleccionadas. Hace uso de una tarjeta de desarrollo FPGA y del Protocolo de comunicación RS232. "spa
dc.formatPDFspa
dc.format.mimetypeapplication/pdfspa
dc.language.isospaspa
dc.publisherPontificia Universidad Javerianaspa
dc.rights.urihttp://creativecommons.org/licenses/by-nc-nd/4.0/*
dc.subjectProcesadorspa
dc.subjectDepuradorspa
dc.subjectCORTEXspa
dc.titleSistema de depuración para procesador CORTEXspa


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GarayRodriguezPabloAndres2014.pdf1.502Mbapplication/pdfVer/

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