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Computación de Borde con FPGA para IoT
| dc.contributor | Tamura, Eugenio | |
| dc.creator | Valderrama, Manuel Alejandro | |
| dc.date | 2023-03-02T01:34:32Z | |
| dc.date | 2023-11-24T07:45:32Z | |
| dc.date | 2023-02-02 | |
| dc.date | 2023-03-02T01:34:32Z | |
| dc.date | 2023-11-24T07:45:32Z | |
| dc.date | 2018 | |
| dc.date.accessioned | 2026-10-15T17:10:51Z | |
| dc.date.available | 2026-10-15T17:10:51Z | |
| dc.identifier | https://vitela.javerianacali.edu.co/handle/11522/737 | |
| dc.identifier.uri | https://hdl.handle.net/20.500.12032/188539 | |
| dc.description | Muchas de las soluciones de software que se pueden encontrar en el mercado actualmente tienen algún grado de procesamiento en la nube,lo que proporciona hardware y software bajo demanda, brindando así al desarrollador herramientas que hace 10 años eran impensables y hoy están al alcance de un click. Las virtudes de la computación en la nube, aunque amplias, implican altos costos operativos y en algunos casos limitan el acceso no por su presupuesto sino por la propia naturaleza de la tecnología involucrada en las comunicaciones(vía Internet), que adiciona diFicultades de tipo operativas en aquellas aplicaciones en las que el tiempo de respuesta es un factor clave. En estos casos, la computación en la nube no se puede tomar ni si quiera como una opción. En este trabajo se pretende hacer uso de la computación de borde y la aceleración por hardware usando FPGAs como una herramienta que optimiza el ancho de banda y la cuota de datos enviados a la nube para su posterior procesamiento,con el objetivo de incrementar el número de proyectos de investigación en el ramo del Internet de las Cosas en el país. | |
| dc.format | application/pdf | |
| dc.format | application/pdf | |
| dc.language | spa | |
| dc.publisher | Pontificia Universidad Javeriana | |
| dc.publisher | Cali | |
| dc.rights | info:eu-repo/semantics/openAccess | |
| dc.rights | https://creativecommons.org/licenses/by-nc/4.0/ | |
| dc.rights | https://creativecommons.org/licenses/by-nc/4.0/ | |
| dc.rights | http://purl.org/coar/access_right/c_abf2 | |
| dc.source | Pontificia Universidad Javeriana | |
| dc.source | Vitela | |
| dc.subject | Facultad de Ingeniería | |
| dc.subject | Maestría en Ingeniería | |
| dc.subject | FPGA | |
| dc.subject | IOT | |
| dc.subject | Aceleración por hardware | |
| dc.title | Computación de Borde con FPGA para IoT | |
| dc.type | Maestría | |
| dc.type | Maestría en ingeniería Electronica | |
| dc.type | http://purl.org/coar/resource_type/c_bdcc | |
| dc.type | info:eu-repo/semantics/masterThesis | |
| dc.type | Tesis/Trabajo de grado - Monografía - Maestría | |
| dc.type | info:eu-repo/semantics/acceptedVersion | |
| dc.type | https://purl.org/redcol/resource_type/TM |
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